Agilex™ 5 FPGA & SoC FPGA
Agilex 5 デバイスは、AI Tensor ブロックによる初の FPGA ファブリックで、より高いコンピューティング密度を実現します1。
これらのミッドレンジ FPGA は、ハイパフォーマンス、低消費電力、および小さいサイズを必要とするアプリケーション向けに最適化されています。
Agilex™ 5 FPGA & SoC FPGA
Agilex™ 5 FPGA の概要ビデオ
Agilex™ 5 FPGA ポートフォリオの主な機能と特長についてのビデオをご覧ください。
Agilex™ 5 FPGA シリーズ
| E シリーズ 消費電力とサイズに合わせて最適化し、エッジや組込みなどのインテリジェントなアプリケーションに理想的です。 |
D シリーズ パフォーマンスと電力効率に合わせて最適化し、多様な市場の幅広いアプリケーションに最適です。 |
|---|---|
| 50K - 656K LE 相当のロジック | 103K - 644K LE 相当のロジック |
| 最小で 15mmx15mm のパッケージサイズ | 最小で 23mmx23mm のパッケージサイズ |
| 最大 24 x 28G トランシーバー | 最大 32 本の 28G トランシーバー |
| 最大 PCIe 4.0 x4 と 10/25GbE x6 ハード IP | 最大 PCIe 4.0 x8 と 25GbE x16 ハード IP |
| DDR4 @2,667Mbps、DDR5 @3,600Mbps、LPDDR4/5 @3,733Mbps | DDR4 @3,200Mbps、DDR5 @4,000Mbps、LPDDR4/4x/5 @4,267Mbps、QDR IV @2,132Mbps |
| 最大 26TOPS（INT8） | 最大 56TOPS（INT8） |
| 最大 1,692 個の18x19 マルチプライヤー | 最大 3,680 個の18x19 マルチプライヤー |
| デュアルコア A55 @1.50GHz およびデュアルコア A76 @1.80GHz のマルチコア Arm プロセッサー | |
| MIPI D-PHY v2.5、最大 3.5Gbps (1 レーン当たり) | |
その他のリソース
開発ボード、Intellectual Property (IP)、サポートなど、Altera® FPGA デバイスに関するその他のコンテンツをご覧ください。
サポートリソース
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開発ボード
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Intellectual Property (IP)
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