Altera SoCエンベデッド・デザイン・スイート（EDS）ユーザ・ガイド

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ID 683187
日付 2/17/2016
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ドキュメント目次
ドキュメント目次 x
1. SoCエンベデッド・デザイン・スイートの概要 2. Altera SoCエンベデッド開発スイートのインストール 3. ライセンス 4. エンベデッド・コマンド・シェル 5. スタート・ガイド 6. ARM DS-5 AE 7. ブート・ツール・ユーザガイド 8. ハードウェア・ライブラリ 9. HPSフラッシュ・プログラマ・ユーザーガイド 10. ベアメタル・コンパイラ 11. SDカード・ブート・ユーティリティ 12. Linuxソフトウェア開発ツール 13. サポートとフィードバックについて
1. SoCエンベデッド・デザイン・スイートの概要 x
1.1. 概要 1.2. ハードウェア開発およびソフトウェア開発の役割 1.3. ハードウェア – ソフトウェアの開発フロー 1.4. 改訂履歴：SoCエンベデッド・デザイン・スイートの概要
1.1. 概要 x
1.1.1. Linuxデバイス・ツリー・バイナリ
1.2. ハードウェア開発およびソフトウェア開発の役割 x
1.2.1. ハードウェア・エンジニア 1.2.2. ベアメタル開発者およびRTOS開発者 1.2.3. Linuxカーネル開発者およびドライバ開発者 1.2.4. Linuxアプリケーション開発者
2. Altera SoCエンベデッド開発スイートのインストール x
2.1. インストール・フォルダ 2.2. SoC EDSのインストール 2.3. ARM DS-5 Altera Editionツールキットのインストール 2.4. 改訂履歴：Altera SoCエンベデッド開発スイートのインストール
3. ライセンス x
3.1. ライセンスの取得 3.2. ライセンスのアクティベーション 3.3. 改訂履歴：SoCエンベデッド・デザイン・スイートのライセンス
4. エンベデッド・コマンド・シェル x
4.1. 改訂履歴：エンベデッド・コマンド・シェル
5. スタート・ガイド x
5.1. 改訂履歴：スタート・ガイド
6. ARM DS-5 AE x
6.1. Eclipse ARM DS-5 AEの起動 6.2. ベアメタル・プロジェクトの管理 6.3. デバッグ 6.4. 改訂履歴：ARM DS-5 AE
6.2. ベアメタル・プロジェクトの管理 x
6.2.1. makefileを使用するベアメタル・プロジェクトの管理 6.2.2. GCCベースのベアメタル・プロジェクト管理 6.2.3. ARMコンパイラのベアメタル・プロジェクト管理
6.2.2. GCCベースのベアメタル・プロジェクト管理 x
6.2.2.1. プロジェクトの作成 6.2.2.2. ビルドの設定
6.2.3. ARMコンパイラのベアメタル・プロジェクト管理 x
6.2.3.1. プロジェクトの作成 6.2.3.2. リンカ・スクリプト 6.2.3.3. ビルドの設定
6.3. デバッグ x
6.3.1. デバッグ・コンフィギュレーションへのアクセス 6.3.2. 新しいデバッグ・コンフィギュレーションの作成 6.3.3. デバッグ・コンフィギュレーション・オプション 6.3.4. DTSLオプション
6.3.3. デバッグ・コンフィギュレーション・オプション x
6.3.3.1. Connectionオプション 6.3.3.2. Fileオプション 6.3.3.3. Debuggerオプション 6.3.3.4. RTOS Awareness 6.3.3.5. Arguments 6.3.3.6. Environment
6.3.4. DTSLオプション x
6.3.4.1. Cross Triggerの設定 6.3.4.2. Trace Captureの設定 6.3.4.3. Cortex-A9の設定 6.3.4.4. STMの設定 6.3.4.5. ETRの設定 6.3.4.6. ETFの設定
7. ブート・ツール・ユーザガイド x
7.1. 概要 7.2. Second Stage Bootloaderサポート・パッケージ・ジェネレータ 7.3. Second Stage Bootloaderイメージ・ツール（mkpimage） 7.4. U-Bootイメージ・ツール（mkimage） 7.5. Second Stageブートローダのビルド方法 7.6. 改訂履歴：ブート・ツール・ユーザガイド
7.2. Second Stage Bootloaderサポート・パッケージ・ジェネレータ x
7.2.1. BSPの生成フロー 7.2.2. BSPジェネレータのGUI 7.2.3. BSPジェネレータのコマンドライン・インタフェース 7.2.4. BSPファイルおよびBSPフォルダ 7.2.5. BSPの設定
7.2.1. BSPの生成フロー x
7.2.1.1. Cyclone VおよびArria Vのフロー 7.2.1.2. Arria 10のフロー
7.2.2. BSPジェネレータのGUI x
7.2.2.1. .tclスクリプトを使用する場合
7.2.3. BSPジェネレータのコマンドライン・インタフェース x
7.2.3.1. bsp-create-settings 7.2.3.2. bsp-update-settings 7.2.3.3. bsp-query-settings 7.2.3.4. bsp-generate-files
7.2.5. BSPの設定 x
7.2.5.1. Cyclone VおよびArria VのBSP設定 7.2.5.2. Arria 10のBSP設定
7.2.5.2. Arria 10のBSP設定 x
7.2.5.2.1. Arria 10の主要なBSP設定グループ 7.2.5.2.2. Arria 10ブートローダMPU FirewallのBSP設定グループ 7.2.5.2.3. Arria 10ブートローダL3 FirewallのBSP設定グループ 7.2.5.2.4. Arria 10ブートローダF2S FirewallのBSP設定グループ
7.3. Second Stage Bootloaderイメージ・ツール（mkpimage） x
7.3.1. mkpimageツールの動作 7.3.2. ヘッダ・ファイルのフォーマット 7.3.3. ツールの使用 7.3.4. 出力イメージのレイアウト
7.3.4. 出力イメージのレイアウト x
7.3.4.1. ベース・アドレス 7.3.4.2. サイズ 7.3.4.3. アドレス・アラインメント 7.3.4.4. パディング
7.3.4.3. アドレス・アラインメント x
7.3.4.3.1. NANDフラッシュ 7.3.4.3.2. シリアルNORフラッシュ 7.3.4.3.3. SD/MMC
7.4. U-Bootイメージ・ツール（mkimage） x
7.4.1. ツール・オプション 7.4.2. 使用例
7.5. Second Stageブートローダのビルド方法 x
7.5.1. Cyclone VおよびArria Vのプリローダのビルド方法 7.5.2. Arria 10ブートローダのビルド方法
8. ハードウェア・ライブラリ x
8.1. 各機能の説明 8.2. ハードウェア・ライブラリ参考資料 8.3. システム・メモリ・マップ 8.4. 改訂履歴：ハードウェア・ライブラリ
8.1. 各機能の説明 x
8.1.1. SoC抽象化レイヤ（SoCAL） 8.1.2. ハードウェア・マネージャ（HW Manager）
9. HPSフラッシュ・プログラマ・ユーザーガイド x
9.1. HPSフラッシュ・プログラマのコマンドライン・ユーティリティ 9.2. HPSフラッシュ・プログラマの動作 9.3. コマンドラインからフラッシュ・プログラマを使用する 9.4. サポートされているメモリ・デバイス 9.5. 改訂履歴：HPSフラッシュ・プログラマ・ユーザーガイド
9.3. コマンドラインからフラッシュ・プログラマを使用する x
9.3.1. HPSフラッシュ・プログラマ 9.3.2. HPSフラッシュ・プログラマのコマンドラインの例
10. ベアメタル・コンパイラ x
10.1. 改訂履歴：ベアメタル・コンパイラ
11. SDカード・ブート・ユーティリティ x
11.1. 使用状況シナリオ 11.2. ツール・オプション 11.3. 改訂履歴：SDカード・ブート・ユーティリティ
12. Linuxソフトウェア開発ツール x
12.1. Linuxコンパイラ 12.2. Linuxデバイス・ツリー・ジェネレータ 12.3. 改訂履歴：Linuxソフトウェア開発ツール
13. サポートとフィードバックについて x
13.1. 改訂履歴：サポートとフィードバックについて
1. SoCエンベデッド・デザイン・スイートの概要
2. Altera SoCエンベデッド開発スイートのインストール
3. ライセンス
4. エンベデッド・コマンド・シェル
5. スタート・ガイド
6. ARM DS-5 AE
7. ブート・ツール・ユーザガイド
8. ハードウェア・ライブラリ
9. HPSフラッシュ・プログラマ・ユーザーガイド
10. ベアメタル・コンパイラ
11. SDカード・ブート・ユーティリティ
12. Linuxソフトウェア開発ツール
13. サポートとフィードバックについて

7.3.2. ヘッダ・ファイルのフォーマット

mkpimageヘッダ・ファイルには2つのフォーマットがあります。

  • Version 0 ‐ Cyclone VおよびArria VのSSBL（プリローダ）に使用されます
  • Version 1 ‐ Arria 10のSSBL（ブートローダ）に使用されます

Cyclone VおよびArria Vのプリローダに使用されるVersion 0のヘッダには以下が含まれます。

  • 検証ワード（0x31305341）
  • バージョン・フィールド（0x0で設定されています）
  • フラッグ・フィールド（0x0で設定されています）
  • プリローダ・プログラムで32ビット・ワードで測定されるプログラム・レングス
  • ヘッダ・コンテントの16ビット・チェックサム（0x40 – 0x49）
表 12.  Version 0のヘッダ・フォーマット

0x4A

ヘッダ・チェックサム

0x48

予約（0x0）

0x46

32ビット・ワードのプログラム・レングス（n）

0x45

フラグ

0x44

バージョン

0x40

検証ワード（0x31305341）
図 49. Version 0のヘッダ・フォーマット

Arria 10のブートローダに使用されるVersion 1のヘッダには以下が含まれます。

  • 検証ワード（0x31305341）
  • バージョン・フィールド（0x1で設定されています）
  • フラッグ・フィールド（0x0で設定されています）
  • バイト単位のヘッダ・レングス、0x14で設定されています（20バイト）
  • バイト単位の総プログラム・レングス（例外ベクタとCRC領域を含む）。イメージが有効となるには、レングスは最小で0x5C（92バイト）、最大で0x32000（200KiB）である必要があります。
  • ヘッダの開始（0x40）に対応するプログラム・エントリ・オフセットで、32ビット幅でワード・アラインメントされていなければいけません。デフォルトは0x14で、これより小さい値は無効となります。
  • ヘッダ・コンテントの16ビット・チェックサム（0x40 – 0x51）です。
    図 50. Version 1のヘッダ・フォーマット
表 13.  Version 1のヘッダ・フォーマット

0x52

ヘッダ・チェックサム

0x50

予約（0x0）

0x4c

プログラム・エントリ・オフセット（x）

0x48

バイト単位のプログラム・レングス（n）

0x46

バイト単位のヘッダ・レングス

0x45

フラグ

0x44

バージョン

0x40

検証ワード（0x31305341）

両バージョンのmkpimageヘッダに対するヘッダチェックサムは、0x0から（n*4）-4バイトへのバイト地のCRCチェックサムです。このnはプログラム・レングスを意味します。

CRCは、多項式の標準CRC32です。 
x32 + x26 + x23 + x22 + x16 + x12 + x11 + x10 + x8 + x7 + x5 + x4 + x2 + x + 1
ビットの反映はなく、残りの初期値は0xFFFFFFFF、最終値は0xFFFFFFFFを持つexclusive OR-edです。
レベル 2 の表題