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5.4.1. アルテラモジュラーADC とアルテラモジュラー・デュアルADC のコマンド・インターフェイス
5.4.2. アルテラモジュラーADC とアルテラモジュラー・デュアルADC の応答インターフェイス
5.4.3. アルテラモジュラーADC とアルテラモジュラー・デュアルADC のしきい値インターフェイス
5.4.4. アルテラモジュラーADC とアルテラモジュラー・デュアルADC のCSRインターフェイス
5.4.5. アルテラモジュラーADC とアルテラモジュラー・デュアルADC のIRQ インターフェイス
5.4.6. アルテラモジュラーADC とアルテラモジュラー・デュアルADC のペリフェラル・クロック・インターフェイス
5.4.7. アルテラモジュラーADC とアルテラモジュラー・デュアルADC のペリフェラル・リセット・インターフェイス
5.4.8. アルテラモジュラーADC とアルテラモジュラー・デュアルADC のADC PLL クロック・インターフェイス
5.4.9. アルテラモジュラーADC とアルテラモジュラー・デュアルADC のADC PLL ロック・インターフェイス
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2.2.2.2. シーケンサー・コア
シーケンサー・コアは、ADC ハードIP が処理するさまざまな変換シーケンスを制御します。シーケンサー・コア・レジスターを使用して、ランタイム中に変換モードの設定ができます。
アルテラモジュラーADC またはアルテラモジュラー・デュアルADC IP コアの設定時に、シーケンサー・コアは最大で64 の設定可能なスロットを提供します。各シーケンサー・スロット向けにADC チャネルを選択することにより、ADC チャネルをサンプリングするシーケンスを定義することができます。
シーケンサー・コアは、1 つのクロックドメインを備えています。
図 18. シーケンサー・コアの上位レベルのブロック図
変換モード | 概要 |
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シングルサイクルのADC 変換 |
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連続的なADC 変換 |
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