AN 784: PCI Express* リファレンス・デザインを使用した インテル® Arria® 10 デバイスのパーシャル・リコンフィグレーション

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ID 683856
日付 11/06/2017
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ドキュメント目次
ドキュメント目次 x
1. PCI Express* リファレンス・デザインを使用した インテル® Arria® 10 デバイスのパーシャル・リコンフィグレーション 2. リファレンス・デザイン・ファイル
1. PCI Express* リファレンス・デザインを使用した インテル® Arria® 10 デバイスのパーシャル・リコンフィグレーション x
1.1. リファレンス・デザインの概要 1.2. 使用開始に際して 1.3. リファレンス・デザインのコンポーネント 1.4. リファレンス・デザインのコンパイル 1.5. リファレンス・デザインの検証 1.6. カスタムのペルソナを使用したリファレンス・デザインの拡張 1.7. 改訂履歴
1.1. リファレンス・デザインの概要 x
1.1.1. クロッキング・スキーム 1.1.2. メモリーアドレスのマッピング 1.1.3. フロアプランニング
1.2. 使用開始に際して x
1.2.1. ハードウェアおよびソフトウェア要件 1.2.2. インテル® Arria® 10 GX FPGA開発キットのインストール 1.2.3. Linuxドライバーのインストール 1.2.4. リファレンス・デザインの立ち上げ
1.3. リファレンス・デザインのコンポーネント x
1.3.1. BSP Top
1.3.1. BSP Top x
1.3.1.1. PCI Express* IPコア 1.3.1.2. インテル® Arria® 10 DDR4外部メモリー・インターフェイスのIPコア 1.3.1.3. デザイントップ
1.3.1.3. デザイントップ x
1.3.1.3.1. グローバル・リセット・ロジック 1.3.1.3.2. PRリージョンラッパー 1.3.1.3.3. インテル® Arria® 10 パーシャル・リコンフィグレーション・コントローラーIPコア 1.3.1.3.4. パーシャル・リコンフィグレーション・ロジック
1.5. リファレンス・デザインの検証 x
1.5.1. program_fpga_jtag 1.5.2. program_fpga_pcie example_host_uio
example_host_uio x
1.5.3.1. アプリケーション例のコンパイル 1.5.3.2. アプリケーション例を使用したデザインのプログラミング
1. PCI Express* リファレンス・デザインを使用した インテル® Arria® 10 デバイスのパーシャル・リコンフィグレーション
2. リファレンス・デザイン・ファイル

1.3.1.3.4. パーシャル・リコンフィグレーション・ロジック

リファレンス・デザインは次のペルソナを提供します。
表 5.  リファレンス・デザインのペルソナ
ペルソナ 説明
DDR4 access

メモリースパン全体にわたってスウィープを実行し、最初にライトを行い、次に各アドレスをリードします。.
Basic DSP

27x27 DSP乗算器へのアクセスを提供し、ハードウェア・アクセラレーションを示します。
Basic arithmetic

基本的な32ビットの符号なし加算器を含み、ハードウェア・アクセラレーションを示します。
Game of Life

8x8のライフゲームを含み、ハードウェア・アクセラレーションを示します。
各ペルソナは、固有の識別番号を表すためにpr_dataレジスターに8ビットのpersona_idフィールドを備えています。1個の32ビット制御レジスターと16個のI/Oレジスターが、8ビットのpersona_idに続きます。16個のI/Oレジスターはそれぞれが32ビットで、デバイス入力用に8ビット、デバイス出力用に8ビットを備えています。各ペルソナはこれらのレジスターを別々の方法で使用します。詳細は、各ペルソナのソースコードを参照してください。

さらに、リファレンス・デザインはカスタムのペルソナを実装するためのテンプレートを提供します。このテンプレートのペルソナを使用すると、RTLの変更、レジスターファイルとインターフェイスするラッパーの作成、、コンパイル、デザインの実行が可能となります。

レベル 2 の表題