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1.1. リファレンス・デザインの概要
リファレンス・デザインは次のコンポーネントで構成されています。
- a10_pcie_reference_design.sv—リファレンス・デザイン用のトップレベル・ラッパーです。ボード・サポート・パッケージ (BSP) サブシステムをデバイス・ピンに接続します。
- bsp_top—デザインのすべてのサブシステムを含むデザインのトップレベルです。このモジュールは、 PCIe* IPコア、DDR4外部メモリー・インターフェイスIPコア、デザイン・トップ・モジュールの3つの主要なサブ・コンポーネントで構成されています。この抽象化のレイヤーは、シミュレーションされたAvalon-MMトランザクションを介した、デザインのトップモジュールのシミュレーションを可能にします。
- design_core—PRリージョンの生成、クロック・クロッシングAvalon-MMロジックやパイプライン・ロジックなどのインターフェイス・コンポーネント、クロック、およびグローバルリセットを処理するデザインのコアです。
図 1. インテル® Arria® 10 PCIe* リファレンス・デザインのブロック図
