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インテル® Cyclone® 10 GXデバイスの利点
インテル® Cyclone® 10 GXの機能についての要約
インテル® Cyclone® 10 GXで使用可能なオプション
インテル® Cyclone® 10 GXの最大リソース
インテル® Cyclone® 10 GXのパッケージプラン
インテル® Cyclone® 10 GXデバイスのI/Oバーティカル・マイグレーション
アダプティブ・ロジック・モジュール
可変精度DSPブロック
エンベデッド・メモリー・ブロック
クロック・ネットワークとPLLクロックソース
FPGA汎用I/O
外部メモリー・インターフェイス
PCIe Gen1およびGen2ハードIP
Interlaken ならびに 10 Gbps イーサネット向けエンハンスト PCS ハード IP
低消費電力シリアル・トランシーバー
1.16. ダイナミック・リコンフィグレーション
エンハンスト・コンフィグレーションおよびプロトコル経由のコンフィグレーション
SEUエラーの検出と修正
消費電力管理
インクリメンタル・コンパイル
インテル® Cyclone® 10 GXデバイスの概要 改訂履歴
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インテル® Cyclone® 10 GXデバイスの概要 改訂履歴
ドキュメント・バージョン | 変更内容 |
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2018.07.11 | シングルルートI/O仮想化 (SR-IOV) に関する記述を削除しました。 インテル® Cyclone® 10 GXデバイスは、SR-IOVをサポートしていません。 |
2018.05.07 | PCIeハードIPのトピックに脚注を追加し、x2レーン・コンフィグレーションのみをサポートするデバイスとパッケージの組み合わせを一覧表示しました。 |
日付 | バージョン | 変更内容 |
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2017年11月 | 2017.11.06 |
|
2017年5月 | 2017.05.08 | 初版 |