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インテル® Cyclone® 10 GXデバイスの利点
インテル® Cyclone® 10 GXの機能についての要約
インテル® Cyclone® 10 GXで使用可能なオプション
インテル® Cyclone® 10 GXの最大リソース
インテル® Cyclone® 10 GXのパッケージプラン
インテル® Cyclone® 10 GXデバイスのI/Oバーティカル・マイグレーション
アダプティブ・ロジック・モジュール
可変精度DSPブロック
エンベデッド・メモリー・ブロック
クロック・ネットワークとPLLクロックソース
FPGA汎用I/O
外部メモリー・インターフェイス
PCIe Gen1およびGen2ハードIP
Interlaken ならびに 10 Gbps イーサネット向けエンハンスト PCS ハード IP
低消費電力シリアル・トランシーバー
1.16. ダイナミック・リコンフィグレーション
エンハンスト・コンフィグレーションおよびプロトコル経由のコンフィグレーション
SEUエラーの検出と修正
消費電力管理
インクリメンタル・コンパイル
インテル® Cyclone® 10 GXデバイスの概要 改訂履歴
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エンハンスト・コンフィグレーションおよびプロトコル経由のコンフィグレーション
スキーム | データ幅 | 最大クロックレート (MHz) |
最大データレート (Mbps) 7 |
圧縮復元 | デザイン・セキュリティ8 | リモート・システム・アップデート |
---|---|---|---|---|---|---|
JTAG | 1ビット | 33 | 33 | — | — | — |
EPCQ-Lコンフィグレーション・デバイスを介したアクティブシリアル (AS) | 1ビット、 4ビット |
100 | 400 | あり | あり | あり |
CPLDまたは外部マイクロコントローラーを介したパッシブシリアル (PS) | 1ビット | 100 | 100 | あり | あり | パラレル・フラッシュ・ローダー (PFL) IPコア |
CPLDまたは外部マイクロコントローラーを介した高速パッシブパラレル (FPP) | 8ビット | 100 | 3200 | あり | あり | PFL IPコア |
16ビット | あり | あり | ||||
32ビット | あり | あり | ||||
CvP (Configuration via Protocol) (PCIe*) | ×1、×2、×4レーン |
— | 5000 | あり | あり | — |
CvP (Configuration via Protocol) を使用してPCIeを介して インテル® Cyclone® 10 GXデバイスをコンフィグレーションすることができます。 インテル® Cyclone® 10 GXCVPの実装は、PCIe 100 msのパワーアップ・ツー・アクティブ時間要件に準拠しています。
7 圧縮あるいはデザイン・セキュリティ機能のいずれかをイネーブルすると、最大データレートに影響を与えます。詳細については、 インテル® Cyclone® 10 GXデバイスのデータシートを参照してください。
8 暗号化と圧縮を同時に使用することはできません。