インテルのみ表示可能 — GUID: ucd1488510973483
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DPA ロック時間の仕様
図 2. DPA PLL キャリブレーションがイネーブルされたDPA ロック時間の仕様
規格 | トレーニング・パターン | トレーニング・パターンの1 回の繰り返しにおけるデータ遷移数 | 256 データ遷移ごとの反復回数59 | 最大データ遷移 |
---|---|---|---|---|
SPI-4 | 00000000001111111111 | 2 | 128 | 640 |
パラレル高速I/O | 00001111 | 2 | 128 | 640 |
10010000 | 4 | 64 | 640 | |
その他 | 10101010 | 8 | 32 | 640 |
01010101 | 8 | 32 | 640 |
59 これは記載トレーニング・パターンが256 データ遷移を実現するための反復回数です。