Arria 10 SoCブート・ユーザーガイド

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ID 683735
日付 10/30/2015
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ドキュメント目次
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1. Arria 10 SoCブート・ユーザーガイド
1. Arria 10 SoCブート・ユーザーガイド x
1.1. ブート・プロセス 1.2. ブート・ステージ 1.3. ブート・デバイス 1.4. 第2ステージ・ブートローダのサポート・パッケージ生成ツール 1.5. QSPIブート・デバイスを使用したブートローダの生成 1.6. ブートおよびFPGAのコンフィギュレーション 1.7. ブートのデバッグ 1.8. 付録A：SD/MMCブート・デバイスを使用したブートローダの生成 1.9. 付録 B：UEFIブートローダのビルド 1.10. Arria 10 SoCブート・ユーザーガイドの改訂履歴
1.1. ブート・プロセス x
1.1.1. 一般的なブート・フロー 1.1.2. ベアメタル・ブート・フロー 1.1.3. カスタム・ブート・フロー
1.2. ブート・ステージ x
1.2.1. リセット 1.2.2. 第1ステージ：ブートROM 1.2.3. 第2ステージ：ブートローダ（U-Boot）
1.2.2. 第1ステージ：ブートROM x
1.2.2.1. ブートROMフロー
1.2.3. 第2ステージ：ブートローダ（U-Boot） x
1.2.3.1. 外部ブート・フロー
1.2.3.1. 外部ブート・フロー x
1.2.3.1.1. 一般的なブート・フロー（非セキュア） 1.2.3.1.2. セキュア・ブート・フロー
1.3. ブート・デバイス x
1.3.1. ブート選択 1.3.2. ブートに向けたフラッシュ・メモリ・デバイス 1.3.3. FPGAからのブート
1.3.2. ブートに向けたフラッシュ・メモリ・デバイス x
1.3.2.1. Quad SPIフラッシュ・メモリ 1.3.2.2. SD/MMCフラッシュ・デバイス 1.3.2.3. NANDフラッシュ・デバイス
1.4. 第2ステージ・ブートローダのサポート・パッケージ生成ツール x
1.4.1. ブートローダの生成とフロー
1.4.1. ブートローダの生成とフロー x
1.4.1.1. ステップ1：FPGAデザインのコンパイル 1.4.1.2. ステップ2：ハードウェア・ハンドオフ・ファイル 1.4.1.3. ステップ3：ブート・ローダ・ソースの生成 1.4.1.4. ブートローダ生成ツール：BSPエディタ
1.5. QSPIブート・デバイスを使用したブートローダの生成 x
1.5.1. 前提条件 1.5.2. QSPIを使用したブートローダの生成例
1.7. ブートのデバッグ x
1.7.1. コールド・ブート・デバッグ 1.7.2. ウォーム・ブート・デバッグ 1.7.3. ブートROMおよびブートローダ・デバッグ・レジスタの使用方法 1.7.4. ブート・フラッシュ・デバイスの問題 1.7.5. HPSブートローダのデバッグ
1.8. 付録A：SD/MMCブート・デバイスを使用したブートローダの生成 x
1.8.1. ブートローダの例
1.9. 付録 B：UEFIブートローダのビルド x
1.9.1. 前提条件 1.9.2. サポートされているコンパイラ・ツールチェイン 1.9.3. UEFIソース・コードの入手 1.9.4. Linaroツールチェインを使用したUEFIソース・コードのコンパイル 1.9.5. ARMツールチェインを使用したUEFIソース・コードのコンパイル 1.9.6. UEFIが生成するファイル
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1.7.5. HPSブートローダのデバッグ

デバッガ接続が利用できない状態で、かつHPSがフラッシュからブートしている場合はフラッシュ・デバイス信号をモニタする必要があります。「ブート・フラッシュ・デバイスの問題」の項を参照してください。

デバッガはソース・コードにアクセス可能であるため、ブートローダ実行のデバッグにデバッガを使用することは最も効果的な方法です。以下の汎用的なデバッグ・テクニックが使用可能です。

  • JTAG接続を持つシステムでは、ブートローダの実行をステップ・スルーにはデバッガを使用します。
  • あるいは、ブートローダ・コードはLEDやUARTといったハードウェア・リソースを経由、あるいは未使用のメモリ・ロケーションに書き込むことでより有益なデバッグ情報を提供するよう編集することも可能です。
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