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1. Intel Agilex® 7可変精度DSPブロックの概要
2. Intel Agilex® 7可変精度DSPブロックのアーキテクチャー
3. Intel Agilex® 7可変精度DSPブロックの演算モード
4. Intel Agilex® 7可変精度DSPブロックにおけるデザインの考慮事項
5. Native Fixed Point DSP Intel Agilex® FPGA IPコアのリファレンス
6. Multiply Adder Intel® FPGA IPコアのリファレンス
7. ALTMULT_COMPLEX Intel® FPGA IPコアのリファレンス
8. LPM_MULT Intel® FPGA IPコアのリファレンス
9. LPM_DIVIDE Intel® FPGA IPコアのリファレンス
10. Native Floating Point DSP Intel Agilex® FPGA IPのリファレンス
11. Intel Agilex® 7可変精度DSPブロック・ユーザーガイド・アーカイブ
12. Intel Agilex® 7可変精度DSPブロック・ユーザーガイドの改訂履歴
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2. Intel Agilex® 7可変精度DSPブロックのアーキテクチャー
Intel Agilex® 7可変精度DSPは、次のブロックで構成されます。
DSPの実装 | ブロック・アーキテクチャー |
---|---|
固定小数点演算 |
|
浮動小数点演算 |
|
図 1. 固定小数点演算9 x 9モード
図 2. 固定小数点演算18 x 19モード
図 3. 固定小数点演算27 x 27モード
図 4. 浮動小数点演算16ビット半精度モード
図 5. 浮動小数点演算32ビット単精度モード