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1. Agilex™ 5 FPGA & SoCの概要
2. Agilex™ 5 FPGA & SoCファミリープラン
3. 第2世代 Hyperflex® コア・アーキテクチャー
4. Agilex™ 5 FPGA & SoCにおけるアダプティブ・ロジック・モジュール
5. Agilex™ 5 FPGA & SoCにおける内部エンベデッド・メモリー
6. Agilex™ 5 FPGA & SoCにおける可変精度DSP
7. Agilex™ 5 FPGA & SoC におけるコア・クロック・ネットワーク
8. Agilex™ 5 FPGA & SoCにおける汎用I/O
9. Agilex™ 5 FPGA & SoCにおけるI/O PLL
10. Agilex™ 5 FPGA & SoCにおける外部メモリー・インターフェイス
11. Agilex™ 5 SoCにおけるハード・プロセッサー・システム
12. Agilex™ 5 FPGA & SoCにおけるFPGAトランシーバー
13. Agilex™ 5 FPGA & SoCにおける MIPI* プロトコルサポート
14. Agilex™ 5 FPGA & SoCにおけるバリアブルピッチBGA (VPBGA) パッケージデザイン
15. PCIe* を使用した Agilex™ 5 FPGA & SoC向けプロトコル経由コンフィグレーション
16. Agilex™ 5 FPGA & SoCにおけるデバイス・コンフィグレーションおよびSDM
17. Agilex™ 5 FPGA & SoCにおけるパーシャル・コンフィグレーションおよびダイナミック・コンフィグレーション
18. Agilex™ 5 FPGA & SoCにおけるデバイス・セキュリティー
19. Agilex™ 5 FPGA & SoCにおけるSEUエラー検出および訂正
20. Agilex™ 5 FPGA & SoCの消費電力管理
21. Agilex™ 5 FPGA & SoCにおけるソフトウェアおよびツール
22. Agilex™ 5 FPGA & SoCデバイスの概要の改訂履歴
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4. Agilex™ 5 FPGA & SoCにおけるアダプティブ・ロジック・モジュール
Agilex™ 5 FPGA & SoCでは、拡張アダプティブ・ロジック・モジュール (ALM) を使用しています。これは、 Arria® 10および Stratix® 10などの旧世代のFPGAと同様です。拡張アダプティブ・ロジック・モジュールにより、ロジック機能の効率的な実装や、 Agilex™ 5デバイス、 Arria® 10、 Stratix® 10 FPGAデバイスとの間のIP変換が容易になります。
図 7. ALMブロック図この図では、ALMに8入力フラクチャブル・ルックアップ・テーブル (LUT)、専用の組み込み加算器2個、および専用レジスター4個が備えられています。
主な特長 | 機能 |
---|---|
レジスター数の多さ | 第2世代 Hyperflex® アーキテクチャーとともに、各8入力フラクチャブルLUTにある4つのレジスターにより、コアロジックの使用率が非常に高い場合のコア・パフォーマンスの最大化が可能です。 |
ALM動作モード | 拡張7入力ロジック・ファンクション、シングル6入力ロジック・ファンクション、または2つの小さな独立したファンクション (例えば、2つの4入力ファンクション) を実装することにより、コアロジックの使用率を最適化できます。 |
2つのクロックソース | 各ALMの2つのクロックソースにより、2つの通常クロックと2つの遅延クロックを生成して、ALMレジスターを駆動します。その結果、クロックドメインが増加し、時間借用能力が向上します。 |
追加のLUT出力 | 組み合わせ機能用の追加の高速6-LUTおよび5-LUT出力により、ロジックカスケードのクリティカル・パスが改善されます。 |
レジスターパッキングの改善 | レジスターパッキングの改善 (パッキング済みレジスターパス2個を備えた5入力LUTなど) の結果、ファブリック領域の使用効率が向上し、クリティカル・パスが改善されます。 |
ラッチモードのサポート | ALMにより、アドレス・ラッチ・イネーブルのラッチモードをサポートします。 |
Quartus® Prime開発ソフトウェアでは、ALMロジック構造を利用し、最高のパフォーマンス、最適なロジック使用率、および最短のコンパイル時間を実現します。 Quartus® Prime開発ソフトウェアでは、デザインの再利用を簡素化し、レガシーデザインを Agilex™ 5 FPGA & SocのALMアーキテクチャーに自動マッピングします。