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3.1. ガイドライン:VCCIO範囲における検討事項
3.2. ガイドライン: 電圧リファレンスのI/O規格に関する制約
3.3. ガイドライン:LVTTL / LVCMOS入力バッファのクランプ・ダイオードを有効にする
3.4. ガイドライン: LVDSのI/O制約規則に対する準拠
3.5. ガイドライン:I/O制約のルール
3.6. ガイドライン:アナログ-デジタル・コンバータのI/O制約
3.7. ガイドライン: 外部メモリー・インターフェイスのI/Oに関する制約
3.8. ガイドライン:兼用コンフィグレーション・ピン
3.9. ガイドライン: MAX® 10 E144パッケージのクロックおよびデータ入力信号
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2.4.2. 差動I/O規格の終端
通常、差動I/O規格にはレシーバの2つの信号間に終端抵抗が必要です。終端抵抗はバスの差動負荷インピーダンスと整合する必要があります。
図 10. 差動HSTL I/O規格の終端
図 11. 差動SSTL I/O規格の終端