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Ixiasoft
インテル® Stratix® 10デバイスおよびトランシーバー・チャネル
PCBスタックアップ選択のガイドライン
高速信号PCB配線に関する推奨事項
FPGAファンアウト領域のデザイン
CFP2/CFP4コネクター・ボード・レイアウトのデザイン・ガイドライン
QSFP+/zSFP/QSFP28コネクター・ボード・レイアウトのデザイン・ガイドライン
SMA 2.4 mmレイアウトのデザイン・ガイドライン
Tyco/Amphenol Interlakenコネクターのデザイン・ガイドライン
電気的仕様
AN 766: インテル® Stratix® 10デバイス 高速信号インターフェイス・レイアウトのデザイン・ガイドライン 文書改訂履歴
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AC結合キャパシターのレイアウトおよび最適化のガイドライン
ボード上の0402と0201の両方のキャパシターのサイズをトランシーバー・リンク上のACカップリング・キャパシターとして使用できます。
図 38. 両端にストリップライン配線によるPCB上のACキャパシター配置とGNDカットアウトトレース配線がストリップラインで、ACキャパシターが最上位または最下位レイヤーに取り付けられている構造の詳細

構造の詳細には、次の仕様が含まれます。
- 10 milのドリル穴と20 milのパッド
- キャップは最上位レイヤーに取り付けられ、トレース・ブレークアウトはレイヤー7に配線されます。
- 10 milのスタブ長
- 0201キャパシター・サイズ銅ブロック
- 24 mil x 12 mil x 12 mil
- 0402キャパシター・サイズ銅ブロック
- 40 mil x 12 mil x 12 mil
ボード・スタックアップ・コンフィグレーションには、次の仕様が含まれます。
- 24層で厚さ117 mil
- 8つの信号レイヤー、4つのPWRレーン
- Megtron6材料