Video and Vision Processing Suite Intel® FPGA IPユーザーガイド

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ID 683329
日付 6/26/2023
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ドキュメント目次
ドキュメント目次 x
1. Video and Vision Processing Suiteについて 2. Video and Vision Processing IPのスタートガイド 3. Video and Vision Processing IPの機能の説明 4. Video and Vision Processing IPインターフェイス 5. Video and Vision Processing IPレジスター 6. Video and Vision Processing IPのソフトウェア・プログラミング・モデル 7. Protocol Converter Intel® FPGA IP 8. 3D LUT Intel® FPGA IP 9. AXI-Stream Broadcaster Intel® FPGA IP 10. Bits per Color Sample Adapter Intel FPGA IP 11. Chroma Key Intel® FPGA IP 12. Chroma Resampler Intel® FPGA IP 13. Clipper Intel® FPGA IP 14. Clocked Video Input Intel® FPGA IP 15. Clocked Video to Full-Raster Converter Intel® FPGA IP 16. Clocked Video Output Intel® FPGA IP 17. Color Space Converter Intel® FPGA IP 18. Deinterlacer Intel® FPGA IP 19. FIR Filter Intel® FPGA IP 20. Frame Cleaner Intel® FPGA IP 21. Full-Raster to Clocked Video Converter Intel® FPGA IP 22. Full-Raster to Streaming Converter Intel® FPGA IP 23. Genlock Controller Intel® FPGA IP 24. Generic Crosspoint Intel® FPGA IP 25. Genlock Signal Router Intel® FPGA IP 26. Guard Bands Intel® FPGA IP 27. Interlacer Intel® FPGA IP 28. Mixer Intel® FPGA IP 29. Parallel Converter Intel® FPGA IPのピクセル 30. Scaler Intel® FPGA IP 31. Stream Cleaner Intel® FPGA IP 32. Switch Intel® FPGA IP 33. Tone Mapping Operator Intel® FPGA IP 34. Test Pattern Generator Intel® FPGA IP 35. Video and Vision Monitor Intel FPGA IP 36. Video Frame Buffer Intel® FPGA IP 37. Video Frame Reader Intel FPGA IP 38. Video Frame Writer Intel FPGA IP 39. Video Streaming FIFO Intel® FPGA IP 40. Video Timing Generator Intel® FPGA IP 41. Warp Intel® FPGA IP 42. デザイン・セキュリティー 43. Video and Vision Processing Suiteユーザーガイドの文書改訂履歴
1. Video and Vision Processing Suiteについて x
1.1. Video and Vision Processing IPの機能 1.2. デバイスファミリーのサポート 1.3. Video and Vision Processing IPのリリース情報 1.4. ライトIPと完全IPのバリアント 1.5. ビデオとビジョンの用語集
2. Video and Vision Processing IPのスタートガイド x
2.1. Video and Vision Processing IP評価のタイムアウト動作 2.2. Video and Vision Processing IPの生成 2.3. Video and Vision Processing IPのシミュレーション
3. Video and Vision Processing IPの機能の説明 x
3.1. 補助制御パケット 3.2. レイテンシー 3.3. IPのデバッグ機能 3.4. ストール動作とエラー回復 3.5. Avalonストリーミング・ビデオ・プロトコルとインテルFPGAストリーミング・ビデオ・プロトコルの比較
5. Video and Vision Processing IPレジスター x
5.1. Video and Vision Processing IP制御の例
7. Protocol Converter Intel® FPGA IP x
7.1. Protocol Converter IPについて 7.2. Protocol Converter IPのパラメーター 7.3. Protocol Converter IPの機能の説明 7.4. Protocol Converter IPのインターフェイス 7.5. Protocol Converter IPレジスター 7.6. Protocol Converter IPのソフトウェアAPI
7.1. Protocol Converter IPについて x
7.1.1. Protocol Converter IPのパフォーマンスとリソース
8. 3D LUT Intel® FPGA IP x
8.1. 3D LUT Intel® FPGA IPについて 8.2. 3D LUT IPのパラメーター 8.3. 3D LUT IPブロックの詳細 8.4. 3D LUT IPレジスター 8.5. 3D LUT IPのソフトウェアAPI
8.1. 3D LUT Intel® FPGA IPについて x
8.1.1. 3D LUT IPの機能 8.1.2. 3D LUT IPのパフォーマンスIPおよびリソース情報
8.3. 3D LUT IPブロックの詳細 x
8.3.1. 3D LUT IPのインターフェイス 8.3.2. 3D LUT IPレイテンシー
9. AXI-Stream Broadcaster Intel® FPGA IP x
9.1. AXI-Stream Broadcaster IPについて 9.2. AXI-Stream Broadcaster IPのパラメーター 9.3. AXI-Stream Broadcaster IPのインターフェイス
9.1. AXI-Stream Broadcaster IPについて x
9.1.1. AXI-Stream Broadcaster IPの機能 9.1.2. AXI-Stream Broadcaster IPのパフォーマンスとリソース
10. Bits per Color Sample Adapter Intel FPGA IP x
10.1. Bits per Color Sample Adapter IPについて 10.2. Bits per Color Sample Adapter IPのパラメーター 10.3. Bits per Color Sample Adapter IPのインターフェイス
10.1. Bits per Color Sample Adapter IPについて x
10.1.1. Bits per Color Sample Adapter IPのパフォーマンスとリソース
11. Chroma Key Intel® FPGA IP x
11.1. Chroma Key IPについて 11.2. Chroma Key IPのパラメーター 11.3. Chroma Key IPのインターフェイス 11.4. Chroma Keyの置き換え 11.5. Chroma Key IPレジスター 11.6. Chroma Key IPのソフトウェアAPI
11.1. Chroma Key IPについて x
11.1.1. Chroma Key IPのパフォーマンスとリソース
12. Chroma Resampler Intel® FPGA IP x
12.1. Chroma Resampler IPについて 12.2. Chroma Resampler IPのパラメーター 12.3. Chroma Resampler IPの機能の説明 12.4. Chroma Resampler IPレジスター 12.5. Chroma Resampler IPのソフトウェアAPI
12.1. Chroma Resampler IPについて x
12.1.1. Chroma Resamplerのパフォーマンスとリソース
12.3. Chroma Resampler IPの機能の説明 x
12.3.1. Chroma Resampler IPのインターフェイス
13. Clipper Intel® FPGA IP x
13.1. Clipper IPについて 13.2. Clipper IPのパラメーター 13.3. Clipper IPのインターフェイス 13.4. Clipper IPレジスター 13.5. Clipper IPのソフトウェアAPI
13.1. Clipper IPについて x
13.1.1. Clipper IPのパフォーマンスとリソース
14. Clocked Video Input Intel® FPGA IP x
14.1. Clocked Video Input IPについて 14.2. Clocked Video Input IPの初期化 14.3. Clocked Video Input IPのパラメーター 14.4. Clocked Video Input IPのインターフェイス 14.5. Clocked Video Input IPレジスター 14.6. Clocked Video Input IPのソフトウェアAPI
14.1. Clocked Video Input IPについて x
14.1.1. Clocked Video Input IPの機能 14.1.2. Clocked Video Input IPのパフォーマンスとリソース
15. Clocked Video to Full-Raster Converter Intel® FPGA IP x
15.1. Clocked Video to Full-Raster Converter IPについて 15.2. Clocked Video to Full-Raster Converterのパラメーター 15.3. Clocked Video to Full-Raster Converterのブロックの説明 15.4. Clocked Video Converter to Full-Raster IPレジスター
15.1. Clocked Video to Full-Raster Converter IPについて x
15.1.1. Clocked Video to Full-Raster Converterの機能 15.1.2. Clocked Video to Full-Raster Converterのパフォーマンスとリソース
15.3. Clocked Video to Full-Raster Converterのブロックの説明 x
15.3.1. Clocked Video to Full-Raster Converterのインターフェイス
16. Clocked Video Output Intel® FPGA IP x
16.1. Clocked Video Output IPについて 16.2. Clocked Video Output IPのパラメーター 16.3. Clocked Video Output IPの機能の説明 16.4. Clocked Video Output IPのインターフェイス 16.5. Clocked Video Output IPレジスター 16.6. Clocked Video Output IPのソフトウェアAPI
16.1. Clocked Video Output IPについて x
16.1.1. Clocked Video Output IPのパフォーマンスとリソース 16.1.2. Clocked Video Output IPの機能
17. Color Space Converter Intel® FPGA IP x
17.1. Color Space Converter IPについて 17.2. Color Space Converter IPのパラメーター 17.3. Color Space Converter IPの機能説明 17.4. Color Space Converter IPレジスター 17.5. Color Space Converter IPのソフトウェアAPI
17.1. Color Space Converter IPについて x
17.1.1. Color Space Converter IPの機能 17.1.2. Color Space Converter IPのパフォーマンスとリソース
17.3. Color Space Converter IPの機能説明 x
17.3.1. Color Space Converter IPのインターフェイス
18. Deinterlacer Intel® FPGA IP x
18.1. Deinterlacer IPについて 18.2. Deinterlacerのパラメーター 18.3. Deinterlacerのインターフェイス 18.4. Deinterlacer IPレジスター 18.5. Deinterlacer IPのソフトウェアAPI
18.1. Deinterlacer IPについて x
18.1.1. デインターレーサーのパフォーマンスとリソース
19. FIR Filter Intel® FPGA IP x
19.1. FIR Filterについて 19.2. FIR Filterのパラメーター 19.3. FIR Filter IPの動作 19.4. FIR Filterのインターフェイス 19.5. FIR Filterレジスター 19.6. FIR Filter IPのソフトウェアAPI
19.1. FIR Filterについて x
19.1.1. FIR Filter IPのパフォーマンスとリソース
19.3. FIR Filter IPの動作 x
19.3.1. FIR Filterの処理 19.3.2. FIR Filterの精度 19.3.3. FIR係数の仕様 19.3.4. FIR Filterの対称性 19.3.5. 結果出力データ型の変換
19.3.4. FIR Filterの対称性 x
19.3.4.1. 対称性なし 19.3.4.2. 水平対称 19.3.4.3. 垂直対称 19.3.4.4. 水平および垂直の対称性 19.3.4.5. 対角対称
20. Frame Cleaner Intel® FPGA IP x
20.1. Frame Cleaner IPについて 20.2. Frame Cleaner IPのパラメーター 20.3. Frame Cleaner IPの機能説明 20.4. Frame Cleaner IPのインターフェイス 20.5. Frame Cleaner IPレジスター 20.6. Frame Cleaner IPのソフトウェアAPI
20.1. Frame Cleaner IPについて x
20.1.1. Frame Cleaner IPのパフォーマンスとリソース
21. Full-Raster to Clocked Video Converter Intel® FPGA IP x
21.1. Full-Raster to Clocked Video Converterについて 21.2. Full Raster to Clocked Video Converterのパラメーター 21.3. Full-Raster to Clocked Video Converterブロックの説明 21.4. Full-Raster to Clocked Video Converterレジスター
21.1. Full-Raster to Clocked Video Converterについて x
21.1.1. Full-Raster to Clocked Video Converterの特徴 21.1.2. Full-Raster to Clocked Video Converterのパフォーマンスとリソース使用率
21.3. Full-Raster to Clocked Video Converterブロックの説明 x
21.3.1. Full Raster to Clocked Video Converterのインターフェイス
22. Full-Raster to Streaming Converter Intel® FPGA IP x
22.1. Full-Raster to Streaming Converter IPについて 22.2. Full-Raster to Streaming Converterのパラメーター 22.3. Full-Raster to Streaming Converterのブロックの説明
22.1. Full-Raster to Streaming Converter IPについて x
22.1.1. Full-Raster to Streaming Converterの特徴 22.1.2. Full-Raster to Streaming Converterのパフォーマンスとリソース使用率
22.3. Full-Raster to Streaming Converterのブロックの説明 x
22.3.1. Full-Raster to Streaming Converterのインターフェイス
23. Genlock Controller Intel® FPGA IP x
23.1. Genlock Controller IPについて 23.2. Genlock Controller IPのパラメーター 23.3. Genlock Controller IPの機能説明 23.4. Genlock Controller IPソフトウェアの使用 23.5. Genlock Controller IPレジスター 23.6. Genlock Controller IPのソフトウェアAPI
23.1. Genlock Controller IPについて x
23.1.1. Genlock Controller IPのパフォーマンスとリソース
23.3. Genlock Controller IPの機能説明 x
23.3.1. Genlock Controller IPのインターフェイス
23.4. Genlock Controller IPソフトウェアの使用 x
23.4.1. Genlockコントローラーのフリーランニングの実現 (初期化またはロックからリファレンス・クロックNまで) 23.4.2. リファレンス・クロックNへのロック (Genlock Controller IPフリーランニングから) 23.4.3. VCXOホールドオーバーの設定 23.4.4. Genlock Controller IPの再起動 23.4.5. リファレンス・クロックN Newへのロック (リファレンス・クロックN Oldへのロックから) 23.4.6. リファレンス・クロックまたはVCXOベース周波数への変更 (p50およびp59.94ビデオ・フォーマット間の切り替え、またはその逆) 23.4.7. リファレンス・クロックの妨害 (ケーブルの引っ張り)
24. Generic Crosspoint Intel® FPGA IP x
24.1. Generic Crosspoint IPについて 24.2. Generic Crosspoint IPのパラメーター 24.3. Generic Crosspoint IPのインターフェイス 24.4. Generic Crosspoint IPレジスター 24.5. Generic Crosspoint IPのソフトウェアAPI
24.1. Generic Crosspoint IPについて x
24.1.1. Generic Crosspoint IPの特徴 24.1.2. Generic Crosspointのパフォーマンスとリソース
25. Genlock Signal Router Intel® FPGA IP x
25.1. Genlock Signal Router IPについて 25.2. Genlock Signal Router IPのパラメーター 25.3. Genlock Signal Router IPのインターフェイス 25.4. Genlock Signal Router IPレジスター 25.5. Genlock Signal Router IPのソフトウェアAPI
25.1. Genlock Signal Router IPについて x
25.1.1. Genlock Signal Router IPの機能 25.1.2. Genlock Signal Router IPのパフォーマンスとリソース
26. Guard Bands Intel® FPGA IP x
26.1. Guard Bands IPについて 26.2. Guard Bands IPのパラメーター 26.3. Guard Bands IPのインターフェイス 26.4. Guard Bands IPレジスター 26.5. Guard Bands IPのソフトウェアAPI
26.1. Guard Bands IPについて x
26.1.1. Guard Bands IPのパフォーマンスとリソース
27. Interlacer Intel® FPGA IP x
27.1. Interlacer IPについて 27.2. Interlacer IPのパラメーター 27.3. Interlacer IPの機能の説明 27.4. Interlacer IPレジスター 27.5. Interlacer IPのソフトウェアAPI
27.1. Interlacer IPについて x
27.1.1. Interlacer IPのパフォーマンスとリソース
27.3. Interlacer IPの機能の説明 x
27.3.1. Interlacer IPのインターフェイス
28. Mixer Intel® FPGA IP x
28.1. Mixer IPについて 28.2. Mixer IPのパラメーター 28.3. Mixer IPの機能の説明 28.4. Mixer IPレジスター 28.5. Mixer IPのソフトウェアAPI
28.1. Mixer IPについて x
28.1.1. Mixer IPのパフォーマンスとリソース
28.3. Mixer IPの機能の説明 x
28.3.1. Mixer IPのインターフェイス
29. Parallel Converter Intel® FPGA IPのピクセル x
29.1. Parallel Converter IPのピクセルについて 29.2. Parallel Converter IPパラメーターのピクセル 29.3. Parallel Converterインターフェイスのピクセル 29.4. Parallel Converterレジスターのピクセル 29.5. Parallel Converter IPのピクセルのソフトウェアAPI
29.1. Parallel Converter IPのピクセルについて x
29.1.1. Parallel Converter IPのピクセルのパフォーマンスとリソース
30. Scaler Intel® FPGA IP x
30.1. Scalerについて 30.2. Scaler IPのパラメーター 30.3. Scaler IPの機能の説明 30.4. Scaler IPレジスター 30.5. Scaler IPのソフトウェアAPI
30.1. Scalerについて x
30.1.1. Scaler IPのパフォーマンスとリソース
30.2. Scaler IPのパラメーター x
30.2.1. スケーラーの最大解像度
30.3. Scaler IPの機能の説明 x
30.3.1. 係数の選択 30.3.2. 係数の量子化 30.3.3. エッジ境界でのフィルター動作 30.3.4. 部分的なフレーム・スケーリング 30.3.5. 422および420クロマ・サンプルデータのスケーリング 30.3.6. Scaler IPのインターフェイス
30.3.1. 係数の選択 x
30.3.1.1. Scaler IPのランタイム係数の更新
31. Stream Cleaner Intel® FPGA IP x
31.1. Stream Cleaner IPについて 31.2. Stream Cleaner IPパラメーター 31.3. Stream Cleaner IPの機能説明
31.1. Stream Cleaner IPについて x
31.1.1. Stream Cleaner IPのパフォーマンスとリソース
31.3. Stream Cleaner IPの機能説明 x
31.3.1. Stream Cleaner IPのインターフェイス
32. Switch Intel® FPGA IP x
32.1. Switch IPについて 32.2. Switch IPのパラメーター 32.3. Switch IPの機能の説明 32.4. Switch IPレジスター 32.5. Switch IPのソフトウェアAPI
32.1. Switch IPについて x
32.1.1. Switch IPのパフォーマンスとリソース
32.3. Switch IPの機能の説明 x
32.3.1. Switch IPのレイテンシー 32.3.2. Switch IPのインターフェイス
33. Tone Mapping Operator Intel® FPGA IP x
33.1. Tone Mapping Operator IPについて 33.2. TMO IPのパラメーター 33.3. TMO IPのブロックの説明 33.4. TMO IPレジスター 33.5. TMO IPのソフトウェアAPI
33.1. Tone Mapping Operator IPについて x
33.1.1. TMO IPの機能 33.1.2. TMO IPのパフォーマンスとリソース使用率
33.3. TMO IPのブロックの説明 x
33.3.1. TMO IPのインターフェイス 33.3.2. TMO IPレイテンシー
34. Test Pattern Generator Intel® FPGA IP x
34.1. Test Pattern Generator IPについて 34.2. Test Pattern Generator IPのパラメーター 34.3. Test Pattern Generator IPの機能の説明 34.4. Test Pattern Generator IPレジスター 34.5. Test Pattern Generator IPのソフトウェアAPI
34.1. Test Pattern Generator IPについて x
34.1.1. Test Pattern Generator IPのパフォーマンスとリソース
34.3. Test Pattern Generator IPの機能の説明 x
34.3.1. Test Pattern Generator IPのインターフェイス
35. Video and Vision Monitor Intel FPGA IP x
35.1. Video and Vision Monitor IPについて 35.2. Video and Vision Monitor IPのパラメーター 35.3. Video and Vision Monitor IPの機能の説明 35.4. Video and Vision Monitor IPレジスター 35.5. Video and Vision MonitorのソフトウェアAPI
35.1. Video and Vision Monitor IPについて x
35.1.1. Video and Vision Monitor IPのパフォーマンスとリソース
35.3. Video and Vision Monitor IPの機能の説明 x
35.3.1. Video and Vision Monitor IPのインターフェイス
36. Video Frame Buffer Intel® FPGA IP x
36.1. Video Frame Buffer IPについて 36.2. Video Frame Buffer IPのパラメーター 36.3. Video Frame Buffer IPの機能の説明 36.4. Video Frame Buffer IPレジスター 36.5. Video Frame Buffer IPのソフトウェアAPI
36.1. Video Frame Buffer IPについて x
36.1.1. Video Frame Bufferのパフォーマンスとリソース
36.3. Video Frame Buffer IPの機能の説明 x
36.3.1. Video Frame Buffer IPのインターフェイス
37. Video Frame Reader Intel FPGA IP x
37.1. Video Frame Reader IPについて 37.2. Video Frame Reader IPのパラメーター 37.3. Video Frame Reader IPの機能の説明 37.4. Video Frame Reader IPのレジスター 37.5. Video Frame Reader IPのソフトウェアAPI
37.1. Video Frame Reader IPについて x
37.1.1. Video Frame Reader IPのパフォーマンスとリソース
37.3. Video Frame Reader IPの機能の説明 x
37.3.1. Video Frame Reader IPのインターフェイス
38. Video Frame Writer Intel FPGA IP x
38.1. Video Buffer Writer IPについて 38.2. Video Frame Writer IPのパラメーター 38.3. Video Frame Writer IPの機能の説明 38.4. Video Frame Writer IPレジスター 38.5. Video Frame Writer IPのソフトウェアAPI
38.1. Video Buffer Writer IPについて x
38.1.1. Video Frame Writer IPのパフォーマンスとリソース
38.3. Video Frame Writer IPの機能の説明 x
38.3.1. Video Frame Writer IPのインターフェイス
39. Video Streaming FIFO Intel® FPGA IP x
39.1. Video Streaming FIFO IPについて 39.2. Video Streaming FIFO IPのパラメーター 39.3. Video Streaming FIFO IPのインターフェイス
39.1. Video Streaming FIFO IPについて x
39.1.1. Video Streaming FIFO IPのパフォーマンスとリソース
40. Video Timing Generator Intel® FPGA IP x
40.1. Video Timing Generator IPについて 40.2. Video Timing Generator IPのパラメーター 40.3. Video Timing Generator IPの機能の説明 40.4. Video Timing Generator IPのインターフェイス 40.5. Video Timing Generator IPレジスター 40.6. Video Timing Generator IPのソフトウェアAPI
40.1. Video Timing Generator IPについて x
40.1.1. Video Timing Generator IPの機能 40.1.2. Video Timing Generator IPのパフォーマンスとリソース
41. Warp Intel® FPGA IP x
41.1. Warp IPについて 41.2. Warp IPのパラメーター 41.3. Warp IPのブロックの説明 41.4. Warp IPレジスター 41.5. Warp IPのソフトウェアAPI
41.1. Warp IPについて x
41.1.1. Warp IPの機能 41.1.2. Warp IPのパフォーマンスとリソース使用率
41.3. Warp IPのブロックの説明 x
41.3.1. ブロック・キャッシュ・ツール 41.3.2. Warp IPのインターフェイス 41.3.3. Warp IPのレイテンシー 41.3.4. Warp IPの外部メモリー
41.5. Warp IPのソフトウェアAPI x
41.5.1. Warp IPソフトウェアの使用 41.5.2. Warp IPのソフトウェアのコード例
42. デザイン・セキュリティー x
42.1. メモリー・サブシステム 42.2. デザイン・セキュリティーの考慮
1. Video and Vision Processing Suiteについて
2. Video and Vision Processing IPのスタートガイド
3. Video and Vision Processing IPの機能の説明
4. Video and Vision Processing IPインターフェイス
5. Video and Vision Processing IPレジスター
6. Video and Vision Processing IPのソフトウェア・プログラミング・モデル
7. Protocol Converter Intel® FPGA IP
8. 3D LUT Intel® FPGA IP
9. AXI-Stream Broadcaster Intel® FPGA IP
10. Bits per Color Sample Adapter Intel FPGA IP
11. Chroma Key Intel® FPGA IP
12. Chroma Resampler Intel® FPGA IP
13. Clipper Intel® FPGA IP
14. Clocked Video Input Intel® FPGA IP
15. Clocked Video to Full-Raster Converter Intel® FPGA IP
16. Clocked Video Output Intel® FPGA IP
17. Color Space Converter Intel® FPGA IP
18. Deinterlacer Intel® FPGA IP
19. FIR Filter Intel® FPGA IP
20. Frame Cleaner Intel® FPGA IP
21. Full-Raster to Clocked Video Converter Intel® FPGA IP
22. Full-Raster to Streaming Converter Intel® FPGA IP
23. Genlock Controller Intel® FPGA IP
24. Generic Crosspoint Intel® FPGA IP
25. Genlock Signal Router Intel® FPGA IP
26. Guard Bands Intel® FPGA IP
27. Interlacer Intel® FPGA IP
28. Mixer Intel® FPGA IP
29. Parallel Converter Intel® FPGA IPのピクセル
30. Scaler Intel® FPGA IP
31. Stream Cleaner Intel® FPGA IP
32. Switch Intel® FPGA IP
33. Tone Mapping Operator Intel® FPGA IP
34. Test Pattern Generator Intel® FPGA IP
35. Video and Vision Monitor Intel FPGA IP
36. Video Frame Buffer Intel® FPGA IP
37. Video Frame Reader Intel FPGA IP
38. Video Frame Writer Intel FPGA IP
39. Video Streaming FIFO Intel® FPGA IP
40. Video Timing Generator Intel® FPGA IP
41. Warp Intel® FPGA IP
42. デザイン・セキュリティー
43. Video and Vision Processing Suiteユーザーガイドの文書改訂履歴

38.5. Video Frame Writer IPのソフトウェアAPI

IPには、ランタイム時にIPをソフトウェア制御するためのソフトウェア・ドライバーが含まれています。このIPは、Nios II HALが提供する汎用デバイスモデルのいずれにも適合しません。これは、一連の専用アクセサーをコントロール・レジスターおよびステータスレジスターに公開します。ドライバー構造は基本ドライバー構造を継承するため、 Video and Vision Processing IPのソフトウェアAPI で説明されているすべての一般的なメソッドを適用できます。

レジスター定義ヘッダーファイル: intel_vvp_vfw_regs.h

インクルード・ファイル: intel_vvp_vfw.h

表 760.  Video Frame Writer IPのソフトウェアAPI
名前 説明
intel_vvp_vfw_init Frame Writerインスタンスを初期化します。
intel_vvp_core_* Video and Vision Processing IPのソフトウェア・プログラミング・モデル で定義されたアクセサー。Liteがオンの場合に書き込み可能。LiteがオフでDebug featuresがオンの場合には、読み出しが可能です。
intel_vvp_vfw_get_lite_mode Lite modeがオンの場合に返します。
intel_vvp_vfw_get_debug_enabled Debug featuresがオンの場合に返します。
intel_vvp_vfw_get_max_height サポートされている最大の高さを返します。
intel_vvp_vfw_get_max_width サポートされている最大幅を返します。
intel_vvp_vfw_get_bps カラーサンプルごとのビット数を返します。
intel_vvp_vfw_get_number_of_color_planes ピクセルあたりのカラープレーンの数を返します。
intel_vvp_vfw_get_pixels_in_parallel 並列にストリーミングされるピクセルの数を返します。
intel_vvp_vfw_get_mem_word_packing メモリー内のピクセルパッキングに使用されるアルゴリズムを返します。
intel_vvp_vfw_is_running 現在、IPがビデオデータを処理しているかどうかを返します。
intel_vvp_vfw_get_commit_status コミットされていない書き込みがある場合に返します。
intel_vvp_vfw_get_status ステータスレジスターを読み出します。
intel_vvp_vfw_is_buffer_available フィールドがメモリーにバッファリングされているかどうかを返します。
intel_vvp_vfw_get_buffer_write_count メモリーに書き込まれたフィールドの数を返します。
intel_vvp_vfw_get_buffer_start_addr 最後に使用可能になったバッファーのメモリー内のベースアドレスを返します。
intel_vvp_vfw_is_buffer_f1 最後に使用可能になったバッファーのフィールドがF1フィールドであるかどうかを返します。
intel_vvp_vfw_get_buffer_width 最後に使用可能になったバッファーのフィールド幅を返します。
intel_vvp_vfw_get_buffer_height 最後に使用可能になったバッファーのフィールドの高さを返します。
intel_vvp_vfw_get_field_count 最後の画像情報パケットから抽出されたfield_countフィールドを返します (フルバリアントのみ)。
intel_vvp_vfw_acknowledge_buffer 新しく書き込まれたバッファーを確認します。
intel_vvp_vfw_set_run_mode 実行モードを変更します。
intel_vvp_vfw_get_run_mode 実行モードを返します。
intel_vvp_vfw_set_num_buffers 使用中のバッファーの数を設定します。
intel_vvp_vfw_get_num_buffers 使用中のバッファーの数を返します。
intel_vvp_vfw_set_base_addr メモリー内の最初のバッファーのベースアドレスを設定します。
intel_vvp_vfw_get_base_addr メモリー内の最初のバッファーのベースアドレスを返します。
intel_vvp_vfw_set_inter_buffer_offset メモリー内のフィールドバッファー間のオフセットを設定します。
intel_vvp_vfw_get_inter_buffer_offset メモリー内のフィールドバッファー間のオフセットを返します。
intel_vvp_vfw_set_inter_line_offset メモリー内の行間のオフセットを設定します。
intel_vvp_vfw_get_inter_line_offset メモリー内の行間のオフセットを返します。
intel_vvp_vfw_set_irq_line_threshold 割り込みを発生させるために使用されるラインしきい値を選択します。
intel_vvp_vfw_get_irq_line_threshold 割り込みを発生させるために使用されるラインしきい値を返します。
intel_vvp_vfw_overwrite_broken_fields 壊れたフィールドの上書き動作を選択します。
intel_vvp_vfw_get_overwrite_broken_fields 壊れたフィールドが上書きされた場合に返します。
intel_vvp_vfw_commit_writes すべての未処理の書き込みをコミットします。

enum eIntelVvpVfwPacking

メンバー

kIntelVvpVfwPerfectPacking (0) - 完璧なサンプルパッキング (無駄なビットなし)

kIntelVvpVfwColorPacking (1) - カラーサンプルのパッキング (カラーサンプルのメモリーワードへの分割はなし)

kIntelVvpVfwPixelPacking (2) - ピクセルパッキング (ピクセルのメモリーワードへの分割はなし)

kIntelVvpVfwInvalidPacking (-1) - 無効なパッキングのアルゴリズム (エラーを示すために使用)

説明

メモリー・アルゴリズムのコンフィグレーション可能なサンプルパッキングの列挙

enum eIntelVvpVfwRunMode

メンバー

kIntelVvpVfwStop (0) - Frame Writerが停止

kIntelVvpVfwFreeRunning (1) - Frame Writerが使用可能なすべてのバッファーを使用してラウンドロビン方式で処理中

kIntelVvpVfwSingleShot (3) - すべてのバッファーに一度書き込まれると、Frame Writerが進行し、その後停止

kIntelVvpVfwInvalidRunMode (-1) – 無効な値 (エラーを示すために使用)

説明

さまざまな書き込みメソッドの列挙

intel_vvp_vfw_init

プロトタイプ 
int intel_vvp_vfw_init(intel_vvp_vfw_instance *instance, intel_vvp_core_base base);
説明

Frame Writerのインスタンスを初期化します。ベースアドレスで読み出されたベンダーIDまたは製品IDが一致しない場合、またはレジスターマップのバージョンがサポートされていない場合、初期化は早期に停止します。それ以外の場合、関数はIPコンパイル時のパラメーター化の読み出しと格納に進みます。インスタンスは完全に初期化されていないため、ゼロ以外のエラーコードを返した場合、アプリケーションはそれ以上使用しないでください。

引数

インスタンス - intel_vvp_vfw_instanceソフトウェア・ドライバー・インスタンス構造体へのポインター

ベース - レジスターマップのベースアドレス

戻り値

成功の場合はkIntelVvpCoreOk (0)、エラーの場合は負のエラーコード

コアのベンダーIDがインテルFPGAベンダーID (0x6AF7) ではない場合、kIntelVvpCoreVidErr

product_idがFrame Writer製品IDと一致しない場合、kIntelVvpCorePidErr

インスタンスがヌルポインターの場合は、kIntelVvpCoreInstanceErr

レジスターマップがサポートされていない場合は、kIntelVvpFrameWriterRegMapVersionErr

intel_vvp_vfw_get_lite_mode

プロトタイプ 
bool intel_vvp_vfw_get_lite_mode(intel_vvp_vfw_instance *instance);
説明

LITE_MODEレジスターの値を返します。インスタンスは、完全に初期化された有効なintel_vvp_vfw_instanceである必要があります。

引数

インスタンス - intel_vvp_vfw_instanceソフトウェア・ドライバー・インスタンス構造体へのポインター

戻り値

IPがライトモードでパラメーター化されている場合は、True

intel_vvp_vfw_get_debug_enabled

プロトタイプ 
bool intel_vvp_vfw_get_debug_enabled(intel_vvp_vfw_instance *instance);
説明

DEBUG_ENABLEDレジスターの値を返します。インスタンスは、完全に初期化された有効なintel_vvp_vfw_instanceである必要があります。

引数

インスタンス - intel_vvp_vfw_instanceソフトウェア・ドライバー・インスタンス構造体へのポインター

戻り値

デバッグ機能がイネーブルになってIPがパラメーター化されている場合は、Trueを返します。

intel_vvp_vfw_get_max_height

プロトタイプ 
uint32_t intel_vvp_vfw_get_max_height(intel_vvp_vfw_instance *instance);
説明

MAX_HEIGHTレジスターの値を返します。インスタンスは、完全に初期化された有効なintel_vvp_vfw_instanceである必要があります。

引数

インスタンス - intel_vvp_vfw_instanceソフトウェア・ドライバー・インスタンス構造体へのポインター

戻り値

コンフィグレーション時に設定されたサポートされている最大の高さ

intel_vvp_vfw_get_max_width

プロトタイプ 
uint32_t intel_vvp_vfw_get_max_width(intel_vvp_vfw_instance *instance);
説明

MAX_WIDTHレジスターの値を返します。インスタンスは、完全に初期化された有効なintel_vvp_vfw_instanceである必要があります。

引数

インスタンス - intel_vvp_vfw_instanceソフトウェア・ドライバー・インスタンス構造体へのポインター

戻り値

コンフィグレーション時に設定されたサポートされている最大の幅

intel_vvp_vfw_get_bps

プロトタイプ 
uint8_t intel_vvp_vfw_get_bps(intel_vvp_vfw_instance *instance);
説明

BPSレジスターの値を返します。インスタンスは、完全に初期化された有効なintel_vvp_vfw_instanceである必要があります。

引数

インスタンス - intel_vvp_vfw_instanceソフトウェア・ドライバー・インスタンス構造体へのポインター

戻り値

コンフィグレーション時に選択されたカラーサンプルごとのビット数

intel_vvp_vfw_get_number_of_color_planes

プロトタイプ 
uint8_t intel_vvp_vfw_get_number_of_color_planes(intel_vvp_vfw_instance *instance);
説明

NUMBER_OF_COLOR_PLANESレジスターの値を返します。インスタンスは、完全に初期化された有効なintel_vvp_vfw_instanceである必要があります。

引数

インスタンス - intel_vvp_vfw_instanceソフトウェア・ドライバー・インスタンス構造体へのポインター

戻り値

コンフィグレーション時に選択されたピクセルあたりのカラープレーンの数

intel_vvp_vfw_get_pixels_in_parallel

プロトタイプ 
uint8_t intel_vvp_vfw_get_pixels_in_parallel(intel_vvp_vfw_instance *instance);
説明

PIXELS_IN_PARALLELレジスターの値を返します。インスタンスは、完全に初期化された有効なintel_vvp_vfw_instanceである必要があります。

引数

インスタンス - intel_vvp_vfw_instanceソフトウェア・ドライバー・インスタンス構造体へのポインター

戻り値

コンフィグレーション時に選択された並行してストリーミングされるピクセルの数

intel_vvp_vfw_get_mem_word_packing

プロトタイプ 
eIntelVvpVfwPacking intel_vvp_vfw_get_mem_word_packing(intel_vvp_vfw_instance *instance);
説明

WORD_PACKINGレジスターの値を返します。インスタンスは、完全に初期化された有効なintel_vvp_vfw_instanceである必要があります。

引数

インスタンス - intel_vvp_vfw_instanceソフトウェア・ドライバー・インスタンス構造体へのポインター

戻り値

メモリー内のフィールドのピクセルとカラーサンプルをパッキング/アンパッキングするために使用されるアルゴリズム

intel_vvp_vfw_is_running

プロトタイプ 
bool intel_vvp_vfw_is_running(intel_vvp_vfw_instance* instance);
説明

STATUSレジスターの実行ビットを読み出して返します。インスタンスは、完全に初期化された有効なintel_vvp_vfw_instanceである必要があります。

引数

インスタンス - intel_vvp_vfw_instanceソフトウェア・ドライバー・インスタンス構造体へのポインター

戻り値

IPが現在フィールドを読み出している場合はTrue、2つの出力フィールドの間にある場合はFalse

intel_vvp_vfw_get_commit_status

プロトタイプ 
bool intel_vvp_vfw_get_commit_status(intel_vvp_vfw_instance* instance);
説明

STATUSレジスターのコミット・ステータス・ビットを読み出して返します。インスタンスは、完全に初期化された有効なintel_vvp_vfw_instanceである必要があります。

引数

インスタンス - intel_vvp_vfw_instanceソフトウェア・ドライバー・インスタンス構造体へのポインター

戻り値

コミットされていない書き込みがある場合、True

intel_vvp_vfw_get_status

プロトタイプ 
uint32_t intel_vvp_vfw_get_status(intel_vvp_vfw_instance* instance);
説明

STATUSレジスターを読み出します。インスタンスは、完全に初期化された有効なintel_vvp_vfw_instanceである必要があります。

引数

インスタンス - intel_vvp_vfw_instanceソフトウェア・ドライバー・インスタンス構造体へのポインター

戻り値

STATUSレジスターの内容

intel_vvp_vfw_is_buffer_available

プロトタイプ 
bool intel_vvp_vfw_is_buffer_available(intel_vvp_vfw_instance* instance);
説明

BUFFER_AVAILABLEレジスターを読み出します。インスタンスは、完全に初期化された有効なintel_vvp_vfw_instanceである必要があります。

引数

インスタンス - intel_vvp_vfw_instanceソフトウェア・ドライバー・インスタンス構造体へのポインター

戻り値

intel_vvp_vfw_acknowledge_bufferの最後の呼び出し以降に新しいバッファーがメモリーに書き込まれた場合は、True

intel_vvp_vfw_get_buffer_write_count

プロトタイプ 
uint32_t intel_vvp_vfw_get_buffer_write_count(intel_vvp_vfw_instance* instance);
説明

BUFFER_WRITE_COUNTレジスターを読み出します。インスタンスは、完全に初期化された有効なintel_vvp_vfw_instanceである必要があります。

引数

インスタンス - intel_vvp_vfw_instanceソフトウェア・ドライバー・インスタンス構造体へのポインター

戻り値

メモリーに書き込まれても破棄されなかったバッファーの数

intel_vvp_vfw_get_buffer_start_addr

プロトタイプ 
uint32_t intel_vvp_vfw_get_buffer_start_addr(intel_vvp_vfw_instance* instance);
説明

BUFFER_START_ADDRESSレジスターを読み出します。インスタンスは、完全に初期化された有効なintel_vvp_vfw_instanceである必要があります。

引数

インスタンス - intel_vvp_vfw_instanceソフトウェア・ドライバー・インスタンス構造体へのポインター

戻り値

使用可能としてフラグが付けられた最後のフィールドのメモリーアドレス

intel_vvp_vfw_is_buffer_f1

プロトタイプ 
bool intel_vvp_vfw_is_buffer_f1(intel_vvp_vfw_instance* instance);
説明

BUFFER_F1_FLAGレジスターを読み出して返します。インスタンスは、完全に初期化された有効なintel_vvp_vfw_instanceである必要があります。

引数

インスタンス - intel_vvp_vfw_instanceソフトウェア・ドライバー・インスタンス構造体へのポインター

戻り値

使用可能になった最後のバッファーがF1フィールドの場合は、True

intel_vvp_vfw_get_buffer_width

プロトタイプ 
uint32_t intel_vvp_vfw_get_buffer_width(intel_vvp_vfw_instance* instance);
説明

BUFFER_WIDTHレジスターを読み出して返します。インスタンスは、完全に初期化された有効なintel_vvp_vfw_instanceである必要があります。

引数

インスタンス - intel_vvp_vfw_instanceソフトウェア・ドライバー・インスタンス構造体へのポインター

戻り値

使用可能になった最後のバッファーの幅

intel_vvp_vfw_get_buffer_height

プロトタイプ 
uint32_t intel_vvp_vfw_get_buffer_height(intel_vvp_vfw_instance* instance);
説明

BUFFER_HEIGHTレジスターを読み出して返します。インスタンスは、完全に初期化された有効なintel_vvp_vfw_instanceである必要があります。

引数

インスタンス - intel_vvp_vfw_instanceソフトウェア・ドライバー・インスタンス構造体へのポインター

戻り値

使用可能になった最後のバッファーの高さ

intel_vvp_vfw_get_field_count

プロトタイプ 
uint32_t intel_vvp_vfw_get_field_count(intel_vvp_vfw_instance* instance);
説明

FIELD_COUNTレジスターを読み出して返します。インスタンスは、デバッグがイネーブルになって完全に初期化およびパラメーター化された有効なintel_vvp_vfw_instanceである必要があります。

引数

インスタンス - intel_vvp_vfw_instanceソフトウェア・ドライバー・インスタンス構造体へのポインター

戻り値

T

intel_vvp_vfw_acknowledge_buffer

プロトタイプ 
int intel_vvp_vfw_acknowledge_buffer(intel_vvp_vfw_instance *instance);
説明

BUFFER_ACKNOWLEDGEレジスターに書き込み、将来のバッファー用のスペースを解放します。

引数

インスタンス - intel_vvp_vfw_instanceソフトウェア・ドライバー・インスタンス構造体へのポインター

戻り値

成功の場合はkIntelVvpCoreOk、失敗の場合は負のエラーコード

インスタンスが無効な場合、kIntelVvpCoreInstanceErr

intel_vvp_vfw_set_run_mode

プロトタイプ 
int intel_vvp_vfw_set_run_mode(intel_vvp_vfw_instance *instance, eIntelVvpVfwRunMode run_mode);
説明

RUN_MODEレジスターに新しい値を書き込み、バッファーをメモリーに格納するときに使用する書き込みプロセスを選択します。

引数

インスタンス - intel_vvp_vfw_instanceソフトウェア・ドライバー・インスタンス構造体へのポインター

run_mode - 新しいrun_mode

別の実行モードが選択されるまでフレームライターを停止する場合、kIntelVvpVfwStop

ラウンドロビン方式ですべてのバッファーを使用して受信フィールドを格納する場合、kIntelVvpVfwFreeRunning

すべてのバッファーが一度書き込まれるまで受信フィールドを格納する場合、kIntelVvpVfwSingleShot

戻り値

成功の場合はkIntelVvpCoreOk、失敗の場合は負のエラーコード

インスタンスが無効な場合、kIntelVvpCoreInstanceErr

intel_vvp_vfw_get_run_mode

プロトタイプ 
eIntelVvpVfwRunMode intel_vvp_vfw_get_run_mode(intel_vvp_vfw_instance* instance);
説明

RUN_MODEレジスターの現在の値を読み出して返します。インスタンスは、完全に初期化され、デバッグをイネーブルするようにコンフィグレーションされた有効なintel_vvp_vfw_instanceである必要があります。

引数

インスタンス - intel_vvp_vfw_instanceソフトウェア・ドライバー・インスタンス構造体へのポインター

戻り値

IPがレジスターのリードバックをイネーブルするようにコンフィグレーションされている場合、RUN_MODEレジスターに書き込まれた最後の値

intel_vvp_vfw_set_num_buffers

プロトタイプ 
int intel_vvp_vfw_set_num_buffers(intel_vvp_vfw_instance *instance, uint32_t num_buffers);
説明

NUM_BUFFERSレジスターに新しい値を書き込み、バッファーの数を選択します。

引数

インスタンス - intel_vvp_vfw_instanceソフトウェア・ドライバー・インスタンス構造体へのポインター

num_buffers - 新しいバッファー数

戻り値

成功の場合はkIntelVvpCoreOk、失敗の場合は負のエラーコード

インスタンスが無効な場合、kIntelVvpCoreInstanceErr

intel_vvp_vfw_get_num_buffers

プロトタイプ 
uint32_t intel_vvp_vfw_get_num_buffers(intel_vvp_vfw_instance* instance);
説明

NUM_BUFFERSレジスターの現在の値を読み出して返します。インスタンスは、完全に初期化され、デバッグをイネーブルするようにコンフィグレーションされた有効なintel_vvp_vfw_instanceである必要があります。

引数

インスタンス - intel_vvp_vfw_instanceソフトウェア・ドライバー・インスタンス構造体へのポインター

戻り値

IPがレジスターのリードバックをイネーブルするようにコンフィグレーションされている場合、NUM_BUFFERSレジスターに書き込まれた最後の値

intel_vvp_vfw_set_base_addr

プロトタイプ 
int intel_vvp_vfw_set_base_addr(intel_vvp_vfw_instance *instance, uint32_t base_addr);
説明

BUFFER_BASEレジスターに新しい値を書き込み、メモリー内のバッファーの新しいベースアドレスを選択します。

引数

インスタンス - intel_vvp_vfw_instanceソフトウェア・ドライバー・インスタンス構造体へのポインター

base_addr - 最初のバッファーのベースアドレス

戻り値

成功の場合はkIntelVvpCoreOk、失敗の場合は負のエラーコード

インスタンスが無効な場合、kIntelVvpCoreInstanceErr

intel_vvp_vfw_get_base_addr

プロトタイプ 
uint32_t intel_vvp_vfw_get_base_addr(intel_vvp_vfw_instance* instance);
説明

BUFFER_BASEレジスターの現在の値を読み出して返します。インスタンスは、完全に初期化され、デバッグをイネーブルするようにコンフィグレーションされた有効なintel_vvp_vfw_instanceである必要があります。

引数

インスタンス - intel_vvp_vfw_instanceソフトウェア・ドライバー・インスタンス構造体へのポインター

戻り値

IPがレジスターのリードバックをイネーブルするようにコンフィグレーションされている場合、BUFFER_BASEレジスターに書き込まれた最後の値

intel_vvp_vfw_set_inter_buffer_offset

プロトタイプ 
int intel_vvp_vfw_set_inter_buffer_offset(intel_vvp_vfw_instance *instance, uint32_t inter_buffer_offset);
説明

INTER_BUFFER_OFFSETレジスターに新しい値を書き込み、バッファーの新しいバッファー間オフセットを選択します。

引数

インスタンス - intel_vvp_vfw_instanceソフトウェア・ドライバー・インスタンス構造体へのポインター

inter_buffer_offset - 2つのバッファー間のオフセット (バイト単位)、つまり各バッファーに割り当てられたバイト数

戻り値

成功の場合はkIntelVvpCoreOk、失敗の場合は負のエラーコード

インスタンスが無効な場合、kIntelVvpCoreInstanceErr

intel_vvp_vfw_get_inter_buffer_offset

プロトタイプ 
uint32_t intel_vvp_vfw_get_inter_buffer_offset(intel_vvp_vfw_instance* instance);
説明

INTER_BUFFER_OFFSETレジスターの現在の値を読み出して返します。インスタンスは、完全に初期化され、デバッグをイネーブルするようにコンフィグレーションされた有効なintel_vvp_vfw_instanceである必要があります。

引数

インスタンス - intel_vvp_vfw_instanceソフトウェア・ドライバー・インスタンス構造体へのポインター

戻り値

IPがレジスターのリードバックをイネーブルするようにコンフィグレーションされている場合、INTER_BUFFER_OFFSETレジスターに書き込まれた最後の値

intel_vvp_vfw_set_inter_line_offset

プロトタイプ 
int intel_vvp_vfw_set_inter_line_offset(intel_vvp_vfw_instance *instance, uint32_t inter_line_offset);
説明

INTER_LINE_OFFSETレジスターに新しい値を書き込み、バッファーの新しい行間オフセットを選択します。

引数

インスタンス - intel_vvp_vfw_instanceソフトウェア・ドライバー・インスタンス構造体へのポインター

inter_line_offset - 連続する行間のオフセット (バイト単位)

戻り値

成功の場合はkIntelVvpCoreOk、失敗の場合は負のエラーコード

インスタンスが無効な場合、kIntelVvpCoreInstanceErr

intel_vvp_vfw_get_inter_line_offset

プロトタイプ 
uint32_t intel_vvp_vfw_get_inter_line_offset(intel_vvp_vfw_instance* instance);
説明

INTER_LINE_OFFSETレジスターの現在の値を読み出して返します。インスタンスは、完全に初期化され、デバッグをイネーブルするようにコンフィグレーションされた有効なintel_vvp_vfw_instanceである必要があります。

引数

インスタンス - intel_vvp_vfw_instanceソフトウェア・ドライバー・インスタンス構造体へのポインター

戻り値

IPがレジスターのリードバックをイネーブルするようにコンフィグレーションされている場合、INTER_LINE_OFFSETレジスターに書き込まれた最後の値

intel_vvp_vfw_set_irq_line_threshold

プロトタイプ 
int intel_vvp_vfw_set_irq_line_threshold(intel_vvp_vfw_instance *instance, uint32_t line_threshold);
説明

IRQ_LINE_THRESHOLDレジスターに新しい値を書き込み、割り込みを発生させる新しいしきい値を選択します。

引数

インスタンス - intel_vvp_vfw_instanceソフトウェア・ドライバー・インスタンス構造体へのポインター

line_threshold - 新しい行のしきい値

戻り値

成功の場合はkIntelVvpCoreOk、失敗の場合は負のエラーコード

インスタンスが無効な場合、kIntelVvpCoreInstanceErr

intel_vvp_vfw_get_irq_line_threshold

プロトタイプ 
uint32_t intel_vvp_vfw_get_irq_line_threshold(intel_vvp_vfw_instance* instance);
説明

IRQ_LINE_THRESHOLDレジスターの現在の値を読み出して返します。インスタンスは、完全に初期化され、デバッグをイネーブルするようにコンフィグレーションされた有効なintel_vvp_vfw_instanceである必要があります。

引数

インスタンス - intel_vvp_vfw_instanceソフトウェア・ドライバー・インスタンス構造体へのポインター

戻り値

IPがレジスターのリードバックをイネーブルするようにコンフィグレーションされている場合、選択したバッファーセットのIRQ_LINE_THRESHOLDレジスターに書き込まれた最後の値

intel_vvp_vfw_overwrite_broken_fields

プロトタイプ 
int intel_vvp_vfw_overwrite_broken_fields(intel_vvp_vfw_instance *instance, bool overwrite_broken);
説明

OVERWRITE_BROKENレジスターに新しい値を書き込み、フレームライターが壊れたフィールドを処理する方法を選択します。

引数

インスタンス - intel_vvp_vfw_instanceソフトウェア・ドライバー・インスタンス構造体へのポインター

overwrite_broken - 壊れたフィールドを無視して上書きする場合はTrue、そうでない場合はFalse

戻り値

成功の場合はkIntelVvpCoreOk、失敗の場合は負のエラーコード

インスタンスが無効な場合、kIntelVvpCoreInstanceErr

intel_vvp_vfw_get_overwrite_broken_fields

プロトタイプ 
bool intel_vvp_vfw_get_overwrite_broken_fields(intel_vvp_vfw_instance* instance);
説明

OVERWRITE_BROKENレジスターの現在の値を読み出して返します。インスタンスは、完全に初期化され、デバッグをイネーブルするようにコンフィグレーションされた有効なintel_vvp_vfw_instanceである必要があります。

引数

インスタンス - intel_vvp_vfw_instanceソフトウェア・ドライバー・インスタンス構造体へのポインター

戻り値

IPがレジスターのリードバックをイネーブルするようにコンフィグレーションされている場合、OVERWRITE_BROKENレジスターに書き込まれた最後の値

intel_vvp_vfw_commit_writes

プロトタイプ 
int intel_vvp_vfw_commit_writes(intel_vvp_vfw_instance* instance)
説明

次のフィールドを処理する前に、ペンディング中の書き込みをすべてコミットします。インスタンスは有効である必要があります。

引数

インスタンス - intel_vvp_vfw_instanceソフトウェア・ドライバー・インスタンス構造体へのポインター

戻り値

成功の場合はkIntelVvpCoreOk (0)、それ以外の場合は負のエラーコード

レベル 2 の表題