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1. Video and Vision Processing Suiteについて
2. Video and Vision Processing IPのスタートガイド
3. Video and Vision Processing IPの機能の説明
4. Video and Vision Processing IPインターフェイス
5. Video and Vision Processing IPレジスター
6. Video and Vision Processing IPのソフトウェア・プログラミング・モデル
7. Protocol Converter Intel® FPGA IP
8. 3D LUT Intel® FPGA IP
9. AXI-Stream Broadcaster Intel® FPGA IP
10. Bits per Color Sample Adapter Intel FPGA IP
11. Chroma Key Intel® FPGA IP
12. Chroma Resampler Intel® FPGA IP
13. Clipper Intel® FPGA IP
14. Clocked Video Input Intel® FPGA IP
15. Clocked Video to Full-Raster Converter Intel® FPGA IP
16. Clocked Video Output Intel® FPGA IP
17. Color Space Converter Intel® FPGA IP
18. Deinterlacer Intel® FPGA IP
19. FIR Filter Intel® FPGA IP
20. Frame Cleaner Intel® FPGA IP
21. Full-Raster to Clocked Video Converter Intel® FPGA IP
22. Full-Raster to Streaming Converter Intel® FPGA IP
23. Genlock Controller Intel® FPGA IP
24. Generic Crosspoint Intel® FPGA IP
25. Genlock Signal Router Intel® FPGA IP
26. Guard Bands Intel® FPGA IP
27. Interlacer Intel® FPGA IP
28. Mixer Intel® FPGA IP
29. Parallel Converter Intel® FPGA IPのピクセル
30. Scaler Intel® FPGA IP
31. Stream Cleaner Intel® FPGA IP
32. Switch Intel® FPGA IP
33. Tone Mapping Operator Intel® FPGA IP
34. Test Pattern Generator Intel® FPGA IP
35. Video and Vision Monitor Intel FPGA IP
36. Video Frame Buffer Intel® FPGA IP
37. Video Frame Reader Intel FPGA IP
38. Video Frame Writer Intel FPGA IP
39. Video Streaming FIFO Intel® FPGA IP
40. Video Timing Generator Intel® FPGA IP
41. Warp Intel® FPGA IP
42. デザイン・セキュリティー
43. Video and Vision Processing Suiteユーザーガイドの文書改訂履歴
23.4.1. Genlockコントローラーのフリーランニングの実現 (初期化またはロックからリファレンス・クロックNまで)
23.4.2. リファレンス・クロックNへのロック (Genlock Controller IPフリーランニングから)
23.4.3. VCXOホールドオーバーの設定
23.4.4. Genlock Controller IPの再起動
23.4.5. リファレンス・クロックN Newへのロック (リファレンス・クロックN Oldへのロックから)
23.4.6. リファレンス・クロックまたはVCXOベース周波数への変更 (p50およびp59.94ビデオ・フォーマット間の切り替え、またはその逆)
23.4.7. リファレンス・クロックの妨害 (ケーブルの引っ張り)
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13.2. Clipper IPのパラメーター
| パラメーター | 値 | 説明 |
|---|---|---|
| Video Data Format | ||
| Bits per color sample | 8～16 | カラーサンプルごとのビット数を選択します。 |
| Number of color planes | 1～4 | ピクセルあたりのカラープレーンの数を選択します。 |
| Number of pixels in parallel | 1～8 | 並列ピクセル数を選択します。 |
| Control | ||
| Lite mode | オンまたはオフ | オンにすると、Intel FPGA Streaming Videoプロトコルのライトバリアントを使用できます。 |
| Memory-mapped control interface | オンまたはオフ | Avalonメモリーマップド・インターフェイスを使用してクリッピング・オフセットを指定するには、オンにします。 Lite modeをオンにする場合は、Avalonメモリーマップド制御エージェント・インターフェイスが必要です。 |
| Separate clock for control interface | オンまたはオフ | 制御インターフェイスの別のクロックをオンにします。 |
| Debug features | オンまたはオフ | デバッグ機能をオンにします (Lite modeをオンにした場合は適用なし)。 |
| Clipping options | ||
| Clipping method | Clipping with offsetsまたはClipping with output dimensions | クリッピング領域を入力領域の端からのオフセットまたは固定長方形として指定します。 |
| Left offset |
0から16383 | 固定寸法のクリップの場合は、クリッピング四角形の左端のx座標を指定します。 0は入力領域の左端です。 左右のオフセット値は入力画像の幅以下である必要があります。 |
| Top offset 15 |
0から16383 | 固定寸法のクリップの場合は、クリッピング四角形の上端のx座標を指定します。 0は入力領域の上端です。 上部と下部のオフセット値は、入力画像の高さ以下である必要があります。 |
| Right offset 15 |
0から16383 | 固定寸法のクリップの場合、このパラメーターを使用して、クリッピング四角形の右端のx座標を指定します。 0は入力領域の右端です。 左右のオフセット値は入力画像の幅以下である必要があります。 |
| Bottom offset 15 |
0から16383 | 固定寸法のクリップの場合は、クリッピング四角形の下端のx座標を指定します。 0は入力領域の下端です。 上部と下部のオフセット値は、入力画像の高さ以下である必要があります。 |
| Output width |
1から16384 | 固定寸法のクリップの場合は、クリッピング四角形の幅を指定します。 |
| Output height 16 |
1から16384 | 固定寸法のクリップの場合は、クリッピング長方形の高さを指定します。 |
図 23. Clipper IP GUI
15
メモリーマップド制御インターフェイスをオンにした場合、またはClipping with output dimensionsを選択した場合は適用されません。
16
メモリーマップド制御インターフェイスをオンにした場合、またはClipping with offsetsを選択した場合は適用されません。