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2.1. インテルFPGA IPコアの紹介
2.2. Intel® FPGA IPコアのインストールとライセンス取得
2.3. IPコアのパラメーターとオプションの指定 ( インテル® Quartus® Primeプロ・エディション)
2.4. IPコア生成の出力 (インテルQuartus Primeプロ・エディション)
2.5. インテルIPコア用に生成されるファイル (従来のパラメーター・エディター)
2.6. インテルFPGA IPコアのシミュレーション
2.7. デザイン階層と一致するSignal Tapデバッグファイルの作成
2.8. LL Ethernet 10G MAC Intel® FPGA IPコアのパラメーター設定
2.9. LL Ethernet 10G MAC Intel® FPGA IPコアのアップグレード
2.10. LL Ethernet 10G MAC Intel® FPGA IPコアのデザインの考慮事項
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4.5. RXデータパス
MAC RXは、XGMIIからイーサネット・フレームを受信し、関連するフレームフィールドを含むペイロードをクライアントに転送します。これは、チェックを実行して無効なフレームをフィルタリングした後に行われます。一部のフレームフィールドは、MAC RXがフレームをクライアントに転送する前に、オプションでフレームから削除されます。
次の図で示しているのは、MAC RXを介したフレームの一般的なフローです。
図 21. 受信インターフェイスでの一般的なクライアント・フレーム